第八章单元测试
  1. 如图电路,设计额定增益为10,即,要求增益误差为5%,确定A1的最小值为( )

    图片2.jpg



  2. A:

    1000

    B:

    100

    C:

    10

    D:

    10000


    答案:

    1000


  3. 假定运放是一个单极点电压放大器,若Vin是小的阶跃电压,计算当输出电压处于其最终值的1%范围内所需的时间约为时间常数的多少倍?

    图片1.jpg



  4. A:

    10

    B:

    5

    C:

    4.6

    D:

    2.3

  5. 对于以下单极点电压放大器,若,且输出达到终值的1%所需的稳定时间小于5ns,运放必须提供的单位增益带宽约为多少?


    图片1.jpg



  6. A:

    9.21Grad/s

    B:

    7.21Grad/s

    C:

    5Grad/s

    D:

    12Grad/s

  7. 以下电路的开环输出阻抗为(  )?

    捕获82.jpg


  8. A:

    捕获41.JPG

    B:

    捕获1111.JPG

    C:

    捕获42.JPG

    D:

    捕获43.JPG

  9. 该电路的环路增益为( )?

    捕获82.jpg


  10. A:

    捕获4.jpg

    B:

    捕获1.JPG

    C:

    捕获3.jpg

    D:

    捕获2.jpg

  11. 分析该电路的闭环输出阻抗为()

    捕获82.jpg


  12. A:

    捕获33.jpg

    B:

    捕获31.jpg

    C:

    捕获34.jpg

    D:

    捕获32.jpg

  13. 如图双端输出共源共栅套筒式电路,假设所有晶体管的相等,则电路的输出摆幅为()

    捕获5.jpg


  14. A:

    捕获1113.JPG

    B:

    捕获1111.jpg

    C:

    捕获1112.jpg

    D:

    捕获1114.jpg

  15. 设所有晶体管的相等,则如图所示单端输出的共源共栅电路的输出摆幅为()

    捕获81.jpg


  16. A:

    捕获1111.JPG

    B:

    捕获111.JPG

    C:

    捕获1114.JPG

    D:

    捕获1115.JPG

  17. 为了解决单级运放增益和摆幅之间的矛盾,可以用两级运放来实现,一般第一级运放用于提高增益,第二级运放用于提高摆幅。


  18. A:对 B:错
  19. 全差分共源共栅运放设计的思路为确定各晶体管的过驱动电压、确定各支路的直流电流、确定各晶体管宽长比、确认各晶体管的尺寸、确定各偏置电压。


  20. A:错 B:对

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